diff --git a/boards/arm/quick_feather/Kconfig.defconfig b/boards/arm/quick_feather/Kconfig.defconfig index b5675fee7ae015..4447235702eeaa 100644 --- a/boards/arm/quick_feather/Kconfig.defconfig +++ b/boards/arm/quick_feather/Kconfig.defconfig @@ -12,6 +12,10 @@ if PWM config PWM_LITEX select SOC_EOS_S3_FPGA + default n + +config EOS_S3_PWM + select EOS_S3_PROGRAM_FPGA default y endif # PWM diff --git a/boards/arm/quick_feather/board.c b/boards/arm/quick_feather/board.c index a0ac48697afda5..87572a802df831 100644 --- a/boards/arm/quick_feather/board.c +++ b/boards/arm/quick_feather/board.c @@ -25,7 +25,7 @@ static int eos_s3_board_init(struct device *arg) eos_s3_io_mux(SPI_SS1_PAD, SPI_SS1_PAD_CFG); #endif -#ifdef CONFIG_PWM_LITEX +#if defined CONFIG_PWM_LITEX || CONFIG_EOS_S3_PWM eos_s3_io_mux(PWM0_PAD, PWM0_PAD_CFG); eos_s3_io_mux(PWM1_PAD, PWM1_PAD_CFG); eos_s3_io_mux(PWM2_PAD, PWM2_PAD_CFG); diff --git a/boards/arm/quick_feather/board.h b/boards/arm/quick_feather/board.h index 8801844619405e..f09c50ca9822dd 100644 --- a/boards/arm/quick_feather/board.h +++ b/boards/arm/quick_feather/board.h @@ -28,7 +28,7 @@ #define SPI_SS1_PAD_CFG SPI_SS1_PAD39 #endif /* CONFIG_SPI_EOS_S3 */ -#ifdef CONFIG_PWM_LITEX +#if defined CONFIG_PWM_LITEX || CONFIG_EOS_S3_PWM /* FPGA IP core peripherals */ #define DT_PWM_GEN_EOS_S3_BASE_ADDRESS DT_QUICKLOGIC_EOS_S3_PWM_GEN_40020000_BASE_ADDRESS #define DT_PWM_GEN_EOS_S3_DIVIDER DT_QUICKLOGIC_EOS_S3_PWM_GEN_40020000_DIVIDER diff --git a/boards/arm/quick_feather/quick_feather.dts b/boards/arm/quick_feather/quick_feather.dts old mode 100644 new mode 100755 index e735dc01a43f85..bfb387f64e562c --- a/boards/arm/quick_feather/quick_feather.dts +++ b/boards/arm/quick_feather/quick_feather.dts @@ -132,8 +132,8 @@ * 0x0001ffff (sectors 16-31) is reserved for use * by the application. */ - storage_partition: partition@10000 { - label = "storage"; + metadata_partition: partition@10000 { + label = "metadata"; reg = <0x00010000 0x00010000>; }; @@ -145,9 +145,18 @@ label = "image-1"; reg = <0x00040000 0x00020000>; }; - scratch_partition: partition@60000 { - label = "image-scratch"; + slot2_partition: partition@60000 { + label = "image-2"; reg = <0x00060000 0x00020000>; }; + slot3_partition: partition@80000 { + label = "image-3"; + reg = <0x00080000 0x00080000>; + }; + storage_partition: partition@100000 { + label = "storage"; + reg = <0x00100000 0x00010000>; + }; + }; }; diff --git a/drivers/led/CMakeLists.txt b/drivers/led/CMakeLists.txt index 3c2f7c114d05cb..4b46a382a8d193 100644 --- a/drivers/led/CMakeLists.txt +++ b/drivers/led/CMakeLists.txt @@ -4,5 +4,6 @@ zephyr_sources_ifdef(CONFIG_HT16K33 ht16k33.c) zephyr_sources_ifdef(CONFIG_LP3943 lp3943.c) zephyr_sources_ifdef(CONFIG_LP5562 lp5562.c) zephyr_sources_ifdef(CONFIG_PCA9633 pca9633.c) +zephyr_sources_ifdef(CONFIG_EOS_S3_LED_BASIC led_eos_s3_basic.c) zephyr_sources_ifdef(CONFIG_USERSPACE led_handlers.c) diff --git a/drivers/led/Kconfig b/drivers/led/Kconfig index 02a288b1767191..823174b5b79df3 100644 --- a/drivers/led/Kconfig +++ b/drivers/led/Kconfig @@ -24,5 +24,6 @@ source "drivers/led/Kconfig.ht16k33" source "drivers/led/Kconfig.lp3943" source "drivers/led/Kconfig.lp5562" source "drivers/led/Kconfig.pca9633" +source "drivers/led/Kconfig.eos_s3_basic" endif # LED diff --git a/drivers/led/Kconfig.eos_s3_basic b/drivers/led/Kconfig.eos_s3_basic new file mode 100644 index 00000000000000..0e85d26623fdb1 --- /dev/null +++ b/drivers/led/Kconfig.eos_s3_basic @@ -0,0 +1,8 @@ +# Copyright 2020 QuickLogic +# Licensed under the Apache License, Version 2.0 + +config EOS_S3_LED_BASIC + bool "EOS S3 basic LED driver" + help + Enable basic LED driver for QL S3. + diff --git a/drivers/led/eos_s3_led_basic_ip.h b/drivers/led/eos_s3_led_basic_ip.h new file mode 100755 index 00000000000000..5d158ce4b77f20 --- /dev/null +++ b/drivers/led/eos_s3_led_basic_ip.h @@ -0,0 +1,1901 @@ +uint32_t axFPGABitStream[] = { + 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, + 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, + 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, + 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, + 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00002000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, + 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, + 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00004000, + 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, + 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 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0x00000000, 0x00000000, 0x00000000, 0x00000000, +}; diff --git a/drivers/led/eos_s3_led_config.h b/drivers/led/eos_s3_led_config.h new file mode 100644 index 00000000000000..15d4c2ea1f5f35 --- /dev/null +++ b/drivers/led/eos_s3_led_config.h @@ -0,0 +1,58 @@ +/* + * ========================================================== + * + * Copyright (C) 2020 QuickLogic Corporation + * Licensed under the Apache License, Version 2.0 (the "License"); + * you may not use this file except in compliance with the License. + * You may obtain a copy of the License at + * http://www.apache.org/licenses/LICENSE-2.0 + * Unless required by applicable law or agreed to in writing, software + * distributed under the License is distributed on an "AS IS" BASIS, + * WITHOUT WARRANTIES OR CONDITIONS OF ANY KIND, either express or implied. + * See the License for the specific language governing permissions and + * limitations under the License. + * + * File : eos_s3_led_config.h + * Purpose : This file contains the IO mux definitions for LEDs + * + * + * =========================================================== + * + */ + + +#ifndef _INC_EOS_S3_LED_CONFIG +#define _INC_EOS_S3_LED_CONFIG + +#include + +/* Set FPGA_LED0 to PAD18 */ +#define FPGA_LED0_PAD18 (PAD_CTRL_SEL_FPGA | PAD_OEN_NORMAL \ + | PAD_P_Z | PAD_SR_SLOW | PAD_E_4MA \ + | PAD_REN_DISABLE | PAD_SMT_DISABLE) +#define FPGA_LED0_PAD18_FBIO PAD18_FUNC_SEL_FBIO_18 + +/* Set FPGA_LED1 to PAD21 */ +#define FPGA_LED1_PAD21 (PAD_CTRL_SEL_FPGA | PAD_OEN_NORMAL \ + | PAD_P_Z | PAD_SR_SLOW | PAD_E_4MA \ + | PAD_REN_DISABLE | PAD_SMT_DISABLE) +#define FPGA_LED1_PAD21_FBIO PAD21_FUNC_SEL_FBIO_21 + +/* Set FPGA_LED2 to PAD22 */ +#define FPGA_LED2_PAD22 (PAD_CTRL_SEL_FPGA | PAD_OEN_NORMAL \ + | PAD_P_Z | PAD_SR_SLOW | PAD_E_4MA \ + | PAD_REN_DISABLE | PAD_SMT_DISABLE) +#define FPGA_LED2_PAD22_FBIO PAD22_FUNC_SEL_FBIO_22 + +#define FPGA_LED0_PAD 18 +#define FPGA_LED0_PAD_CFG FPGA_LED0_PAD18 +#define FPGA_LED0_FBIO_SEL FPGA_LED0_PAD18_FBIO +#define FPGA_LED1_PAD 21 +#define FPGA_LED1_PAD_CFG FPGA_LED1_PAD21 +#define FPGA_LED1_FBIO_SEL FPGA_LED1_PAD21_FBIO +#define FPGA_LED2_PAD 22 +#define FPGA_LED2_PAD_CFG FPGA_LED2_PAD22 +#define FPGA_LED2_FBIO_SEL FPGA_LED2_PAD22_FBIO + + +#endif /* _INC_EOS_S3_LED_CONFIG */ diff --git a/drivers/led/led_eos_s3_basic.c b/drivers/led/led_eos_s3_basic.c new file mode 100644 index 00000000000000..9ea694f9144fe9 --- /dev/null +++ b/drivers/led/led_eos_s3_basic.c @@ -0,0 +1,49 @@ +/* + * ========================================================== + * + * Copyright (C) 2020 QuickLogic Corporation + * Licensed under the Apache License, Version 2.0 (the "License"); + * you may not use this file except in compliance with the License. + * You may obtain a copy of the License at + * http://www.apache.org/licenses/LICENSE-2.0 + * Unless required by applicable law or agreed to in writing, software + * distributed under the License is distributed on an "AS IS" BASIS, + * WITHOUT WARRANTIES OR CONDITIONS OF ANY KIND, either express or implied. + * See the License for the specific language governing permissions and + * limitations under the License. + * + * File : led_eos_s3_basic.c + * Purpose : This is the driver for basic LED controller IP. + * + * + * =========================================================== + * + */ + +#include +#include +#include +#include "eos_s3_led_basic_ip.h" +#include "eos_s3_led_config.h" + +static void config_ios(void) +{ + eos_s3_io_mux(FPGA_LED0_PAD, FPGA_LED0_PAD_CFG); + eos_s3_io_mux(FPGA_LED1_PAD, FPGA_LED1_PAD_CFG); + eos_s3_io_mux(FPGA_LED2_PAD, FPGA_LED2_PAD_CFG); + + eos_s3_fbio_select(FPGA_LED0_PAD, FPGA_LED0_FBIO_SEL); + eos_s3_fbio_select(FPGA_LED1_PAD, FPGA_LED1_FBIO_SEL); + eos_s3_fbio_select(FPGA_LED2_PAD, FPGA_LED2_FBIO_SEL); + +} + +void program_fpga_ip(void) +{ + /* Load bitstrem into FPGA */ + load_fpga(sizeof(axFPGABitStream), axFPGABitStream); + + /* Configure IOs */ + config_ios(); +} + diff --git a/drivers/pwm/CMakeLists.txt b/drivers/pwm/CMakeLists.txt index 86e23c80336ea9..69bd40d6fa1447 100644 --- a/drivers/pwm/CMakeLists.txt +++ b/drivers/pwm/CMakeLists.txt @@ -15,6 +15,8 @@ zephyr_library_sources_ifdef(CONFIG_PWM_SAM pwm_sam.c) zephyr_library_sources_ifdef(CONFIG_PWM_MCUX pwm_mcux.c) zephyr_library_sources_ifdef(CONFIG_PWM_XEC pwm_mchp_xec.c) zephyr_library_sources_ifdef(CONFIG_PWM_LITEX pwm_litex.c) +zephyr_library_sources_ifdef(CONFIG_EOS_S3_PWM pwm_litex.c) +zephyr_library_sources_ifdef(CONFIG_EOS_S3_PWM pwm_eos_s3.c) zephyr_library_sources_ifdef(CONFIG_USERSPACE pwm_handlers.c) zephyr_library_sources_ifdef(CONFIG_PWM_SHELL pwm_shell.c) diff --git a/drivers/pwm/Kconfig b/drivers/pwm/Kconfig index c25c3702dba80a..62795d292fcfe1 100644 --- a/drivers/pwm/Kconfig +++ b/drivers/pwm/Kconfig @@ -61,4 +61,6 @@ source "drivers/pwm/Kconfig.xec" source "drivers/pwm/Kconfig.litex" +source "drivers/pwm/Kconfig.eos_s3" + endif # PWM diff --git a/drivers/pwm/Kconfig.eos_s3 b/drivers/pwm/Kconfig.eos_s3 new file mode 100644 index 00000000000000..56c53ae07aad7a --- /dev/null +++ b/drivers/pwm/Kconfig.eos_s3 @@ -0,0 +1,18 @@ +# Copyright 2020 QuickLogic +# Licensed under the Apache License, Version 2.0 + +menuconfig EOS_S3_PWM + bool "EOS S3 LiteX PWM driver" + depends on HAS_DTS + help + Set if PWM IP generated with EOS S3 tools + +if EOS_S3_PWM + +config PWM_LITEX_INIT_PRIORITY + int "Init priority" + default 70 + help + PWM device driver initialization priority. + +endif # PWM_LITEX diff --git a/drivers/pwm/eos_s3_pwm_ip.h b/drivers/pwm/eos_s3_pwm_ip.h new file mode 100644 index 00000000000000..1d80678c56bb61 --- /dev/null +++ b/drivers/pwm/eos_s3_pwm_ip.h @@ -0,0 +1,1901 @@ +uint32_t axFPGABitStream[] = { + 0x00000000, 0x00000008, 0x00000020, 0x00000000, 0x00000000, 0x00000008, 0x00000000, 0x00000420, 0x00000000, 0x00000000, + 0x00000000, 0x00004000, 0x00000840, 0x00000040, 0x00000000, 0x00000000, 0x00002000, 0x00000000, 0x00000000, 0x000000a0, + 0x00000000, 0x00008000, 0x00000000, 0x00000000, 0x00000000, 0x00001000, 0x00000000, 0x00000008, 0x00000020, 0x00000000, + 0x00000000, 0x00008000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, 0x00000010, 0x00000000, + 0x00000000, 0x00000010, 0x00000000, 0x00000000, 0x00000004, 0x00000000, 0x00002000, 0x00000004, 0x00000000, 0x00000000, + 0x00000800, 0x00000000, 0x00000000, 0x00000000, 0x00000088, 0x00000000, 0x00000010, 0x00000000, 0x00000000, 0x00000008, + 0x00001000, 0x00008020, 0x00004000, 0x00000008, 0x00000000, 0x00000000, 0x00000000, 0x00000080, 0x00000000, 0x00000000, + 0x00000000, 0x00000080, 0x00008000, 0x0000c010, 0x00000000, 0x00000004, 0x00000000, 0x00000050, 0x00000010, 0x00000000, + 0x00000000, 0x00000010, 0x00004000, 0x00000080, 0x00000008, 0x00004020, 0x00000040, 0x00004000, 0x00000020, 0x00000800, + 0x00000004, 0x00008020, 0x00000010, 0x0000c080, 0x00000040, 0x00000000, 0x00000008, 0x00001050, 0x00000050, 0x00000000, + 0x00000000, 0x00002000, 0x00000000, 0x00003000, 0x00000004, 0x00000000, 0x00000080, 0x00000000, 0x00002000, 0x00004000, + 0x00000080, 0x00000004, 0x00001040, 0x00000048, 0x00000000, 0x000000c0, 0x00000000, 0x00000000, 0x00001000, 0x00000080, + 0x00000000, 0x00000020, 0x00000008, 0x00000000, 0x00000028, 0x00004080, 0x00000000, 0x00000008, 0x00002002, 0x00000000, + 0x00000000, 0x00000002, 0x00000000, 0x00000084, 0x00000040, 0x00004000, 0x00000000, 0x00000000, 0x00000000, 0x00000000, + 0x00008000, 0x00000000, 0x00000080, 0x00000000, 0x00000000, 0x00000440, 0x00000020, 0x00000000, 0x00000000, 0x00000010, + 0x00000000, 0x00000000, 0x00002008, 0x00000000, 0x00008000, 0x00000004, 0x00000000, 0x00004000, 0x00000000, 0x00000000, + 0x00000000, 0x00000080, 0x0000a000, 0x00000004, 0x00008400, 0x00000000, 0x00005040, 0x00000820, 0x00000000, 0x00000000, + 0x00001010, 0x00000000, 0x00000000, 0x00000000, 0x00000008, 0x00008000, 0x00006004, 0x00000000, 0x00000000, 0x00000002, + 0x00000000, 0x000008a0, 0x00008000, 0x00001008, 0x00006010, 0x00000000, 0x00000000, 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+1,32 @@ +/* + * ========================================================== + * + * Copyright (C) 2020 QuickLogic Corporation + * Licensed under the Apache License, Version 2.0 (the "License"); + * you may not use this file except in compliance with the License. + * You may obtain a copy of the License at + * http://www.apache.org/licenses/LICENSE-2.0 + * Unless required by applicable law or agreed to in writing, software + * distributed under the License is distributed on an "AS IS" BASIS, + * WITHOUT WARRANTIES OR CONDITIONS OF ANY KIND, either express or implied. + * See the License for the specific language governing permissions and + * limitations under the License. + * + * File : pwm_eos_s3.c + * Purpose : This file has the function to load pwm fpga ip + * + * + * =========================================================== + */ + +#include +#include +#include +#include "eos_s3_pwm_ip.h" + +void program_fpga_ip(void) +{ + /* Load bitstrem into FPGA */ + load_fpga(sizeof(axFPGABitStream), axFPGABitStream); +} + diff --git a/samples/drivers/led_eos_s3_basic/CMakeLists.txt b/samples/drivers/led_eos_s3_basic/CMakeLists.txt new file mode 100644 index 00000000000000..3baac6bff034fb --- /dev/null +++ b/samples/drivers/led_eos_s3_basic/CMakeLists.txt @@ -0,0 +1,10 @@ +# Copyright (C) 2020 QuickLogic Corporation +# Licensed under the Apache License, Version 2.0 + +cmake_minimum_required(VERSION 3.13.1) +include($ENV{ZEPHYR_BASE}/cmake/app/boilerplate.cmake NO_POLICY_SCOPE) +project(led_eos_s3_basic) + +FILE(GLOB app_sources src/*.c) +target_sources(app PRIVATE ${app_sources}) +#add_definitions( -DDBUG) diff --git a/samples/drivers/led_eos_s3_basic/README.rst b/samples/drivers/led_eos_s3_basic/README.rst new file mode 100644 index 00000000000000..87137ee030a64e --- /dev/null +++ b/samples/drivers/led_eos_s3_basic/README.rst @@ -0,0 +1,25 @@ +.. _eos_s3_basic: + +EOS_S3_BASIC: Preconfigured LED +########################### + +Overview +******** + +This sample blinks the LEDs which is preconfigured in the FPGA IP + + +Building and Running +******************** + +Build the application for the :ref:`quick_feather` board. + +.. zephyr-app-commands:: + :zephyr-app: samples/drivers/led_eos_s3_basic + :board: quick_feather + :goals: build + :compact: + +For flashing the application, refer to the Flashing section of the +:ref:`quick_feather` board documentation. + diff --git a/samples/drivers/led_eos_s3_basic/prj.conf b/samples/drivers/led_eos_s3_basic/prj.conf new file mode 100644 index 00000000000000..5a0996b9b1d96e --- /dev/null +++ b/samples/drivers/led_eos_s3_basic/prj.conf @@ -0,0 +1 @@ +CONFIG_LED=y diff --git a/samples/drivers/led_eos_s3_basic/sample.yaml b/samples/drivers/led_eos_s3_basic/sample.yaml new file mode 100644 index 00000000000000..3d2e4da738eef2 --- /dev/null +++ b/samples/drivers/led_eos_s3_basic/sample.yaml @@ -0,0 +1,8 @@ +sample: + description: Demonstration of the eos_s3 basic LED driver + name: led_eos_s3_basic sample +tests: + sample.drivers.led.eos_s3_basic: + platform_whitelist: quick_feather + tags: led + harness: TBD diff --git a/samples/drivers/led_eos_s3_basic/src/main.c b/samples/drivers/led_eos_s3_basic/src/main.c new file mode 100644 index 00000000000000..50762450aa9a19 --- /dev/null +++ b/samples/drivers/led_eos_s3_basic/src/main.c @@ -0,0 +1,36 @@ +/* + * ========================================================== + * + * Copyright (C) 2020 QuickLogic Corporation + * Licensed under the Apache License, Version 2.0 (the "License"); + * you may not use this file except in compliance with the License. + * You may obtain a copy of the License at + * http://www.apache.org/licenses/LICENSE-2.0 + * Unless required by applicable law or agreed to in writing, software + * distributed under the License is distributed on an "AS IS" BASIS, + * WITHOUT WARRANTIES OR CONDITIONS OF ANY KIND, either express or implied. + * See the License for the specific language governing permissions and + * limitations under the License. + * + * File : main.c + * Purpose : This file has simple prints. + * No other configuration needs to be done here + * + * =========================================================== + */ + +#include +#include +#include + +void main(void) +{ + printk("\n\n"); + printk("##########################\n"); + printk("Quicklogic Open Platform 2.0\n"); + printk("SW Version: "); + printk(" OP2-QuickFeather-led-eos-s3-basic sample"); + printk("\n"); + printk(__DATE__ " " __TIME__ "\n"); + printk("##########################\n\n"); +} diff --git a/samples/drivers/spi_flash/src/main.c b/samples/drivers/spi_flash/src/main.c old mode 100644 new mode 100755 index 1cf53f47cf8bfb..0d55c2f47230a2 --- a/samples/drivers/spi_flash/src/main.c +++ b/samples/drivers/spi_flash/src/main.c @@ -21,7 +21,11 @@ #error Unsupported flash driver #endif +#ifdef CONFIG_BOARD_QUICK_FEATHER +#define FLASH_TEST_REGION_OFFSET 0x100000 +#else #define FLASH_TEST_REGION_OFFSET 0xff000 +#endif #define FLASH_SECTOR_SIZE 4096 void main(void) diff --git a/soc/arm/quicklogic_eos_s3/CMakeLists.txt b/soc/arm/quicklogic_eos_s3/CMakeLists.txt index 07d9bfb204890b..847db868766746 100644 --- a/soc/arm/quicklogic_eos_s3/CMakeLists.txt +++ b/soc/arm/quicklogic_eos_s3/CMakeLists.txt @@ -6,3 +6,5 @@ zephyr_sources( soc.c irq_handlers.c ) +zephyr_sources_ifdef(CONFIG_EOS_S3_PROGRAM_FPGA fpga_loader.c) + diff --git a/soc/arm/quicklogic_eos_s3/Kconfig b/soc/arm/quicklogic_eos_s3/Kconfig index 246b39fc430775..ef827a94034d32 100644 --- a/soc/arm/quicklogic_eos_s3/Kconfig +++ b/soc/arm/quicklogic_eos_s3/Kconfig @@ -13,3 +13,9 @@ config SOC_EOS_S3_FPGA bool help Enable on chip FPGA + +config EOS_S3_PROGRAM_FPGA + bool + help + Enable programming the FPGA IP on EOS S3 + diff --git a/soc/arm/quicklogic_eos_s3/Kconfig.defconfig b/soc/arm/quicklogic_eos_s3/Kconfig.defconfig index ba8e0ac161f8fa..44598d10230a98 100644 --- a/soc/arm/quicklogic_eos_s3/Kconfig.defconfig +++ b/soc/arm/quicklogic_eos_s3/Kconfig.defconfig @@ -57,4 +57,10 @@ config SPI_EOS_S3 endif # SPI +if LED +config EOS_S3_LED_BASIC + select EOS_S3_PROGRAM_FPGA + default y +endif # LED + endif # SOC_EOS_S3 diff --git a/soc/arm/quicklogic_eos_s3/fpga_loader.c b/soc/arm/quicklogic_eos_s3/fpga_loader.c new file mode 100755 index 00000000000000..04f9d513878da1 --- /dev/null +++ b/soc/arm/quicklogic_eos_s3/fpga_loader.c @@ -0,0 +1,92 @@ +/* + * ========================================================== + * + * Copyright 2020 QuickLogic + * + * Licensed under the Apache License, Version 2.0 (the "License"); + * you may not use this file except in compliance with the License. + * You may obtain a copy of the License at + * + * http://www.apache.org/licenses/LICENSE-2.0 + * + * Unless required by applicable law or agreed to in writing, software + * distributed under the License is distributed on an "AS IS" BASIS, + * WITHOUT WARRANTIES OR CONDITIONS OF ANY KIND, either express or implied. + * See the License for the specific language governing permissions and + * limitations under the License. + * + * + * File : fpga_loader.c + * Purpose: Contains functionality to load FPGA + * + *========================================================= + */ + + +#include +#include + +#define CFG_CTL_CFG_DATA (*(volatile u32_t *)(0x40014FFC)) +#define CFG_CTL_CFG_CTL (*(volatile u32_t *)(0x40014000)) + + +int load_fpga(u32_t img_size, u32_t *image_ptr) +{ + unsigned int i = 0; + u32_t chunk_cnt = 0; + volatile u32_t *gFPGAPtr = (volatile u32_t *)image_ptr; + + IO_MUX->PAD_19_CTRL = 0x00000180; + + enable_fpga_clocks(); + + /* wait some time for fpga to get reset pulse */ +#if 0 + k_sleep(100); +#else + for (i = 0; i < 60; i++) + PMU->GEN_PURPOSE_1 = i << 4; +#endif + + /* Configuration of CFG_CTRL for writes */ + CFG_CTL_CFG_CTL = 0xBDFF; + +#if 0 + k_sleep(100); +#else + for (i = 0; i < 60; i++) + PMU->GEN_PURPOSE_1 = i << 4; +#endif + + for (chunk_cnt = 0; chunk_cnt < (img_size/4); chunk_cnt++) + CFG_CTL_CFG_DATA = gFPGAPtr[chunk_cnt]; + + /* wait some time for fpga to get reset pulse */ +#if 0 + k_sleep(100); +#else + for (i = 0; i < 60; i++) + PMU->GEN_PURPOSE_1 = i << 4; +#endif + + /* exit config mode */ + CFG_CTL_CFG_CTL = 0x0; + PMU->GEN_PURPOSE_0 = 0; /* set APB_FB_EN = 0 for normal mode */ + + PMU->FB_ISOLATION = 0; + + CRU->FB_SW_RESET = 0; + CRU->FB_MISC_SW_RST_CTL = 0; + PMU->GEN_PURPOSE_1 = 0x90; + + /* required wait time before releasing LTH_ENB */ +#if 0 + k_sleep(100); +#else + for (i = 0; i < 60; i++) + PMU->GEN_PURPOSE_1 = i << 4; +#endif + IO_MUX->PAD_19_CTRL = 0x000009a0; + + return 0; +} diff --git a/soc/arm/quicklogic_eos_s3/fpga_loader.h b/soc/arm/quicklogic_eos_s3/fpga_loader.h new file mode 100755 index 00000000000000..01b3526fcba414 --- /dev/null +++ b/soc/arm/quicklogic_eos_s3/fpga_loader.h @@ -0,0 +1,24 @@ +/*========================================================== + * + * Copyright 2020 QuickLogic + * + * Licensed under the Apache License, Version 2.0 (the "License"); + * you may not use this file except in compliance with the License. + * You may obtain a copy of the License at + * + * http://www.apache.org/licenses/LICENSE-2.0 + * + * Unless required by applicable law or agreed to in writing, software + * distributed under the License is distributed on an "AS IS" BASIS, + * WITHOUT WARRANTIES OR CONDITIONS OF ANY KIND, either express or implied. + * See the License for the specific language governing permissions and + * limitations under the License. + * + * + * File : fpga_loader.h + * Purpose: Contains functionality to load FPGA + * + *========================================================= + */ + +int load_fpga(u32_t img_size, u32_t *image_ptr); diff --git a/soc/arm/quicklogic_eos_s3/soc.c b/soc/arm/quicklogic_eos_s3/soc.c index b793fe99ead316..e5a76c5d642a97 100644 --- a/soc/arm/quicklogic_eos_s3/soc.c +++ b/soc/arm/quicklogic_eos_s3/soc.c @@ -80,6 +80,47 @@ int eos_s3_io_mux(u32_t pad_nr, u32_t pad_cfg) return 0; } +int eos_s3_fbio_select(u32_t pad_nr, u32_t ucFunc) +{ + u32_t uiExtRegAddr; + u32_t *pExtRegAddr; + + uiExtRegAddr = ucFunc >> EXT_REG_OFFSET_SHIFT; + + if (uiExtRegAddr == FBIO_SEL_2) { + uiExtRegAddr = uiExtRegAddr | IO_MUX_BASE; + pExtRegAddr = (uint32_t *)uiExtRegAddr; + *pExtRegAddr |= 1 << (pad_nr - 32); + } else { + uiExtRegAddr |= IO_MUX_BASE; + pExtRegAddr = (uint32_t *)uiExtRegAddr; + *pExtRegAddr |= 1 << pad_nr; + } + + return 0; +} +void enable_fpga_clocks(void) +{ + PMU->FFE_FB_PF_SW_WU = PMU_FFE_FB_PF_SW_WU_PF_WU + | PMU_FFE_FB_PF_SW_WU_FB_WU + | PMU_FFE_FB_PF_SW_WU_FFE_WU; + CRU->FB_SW_RESET = FB_C21_DOMAIN_SW_RESET | FB_C16_DOMAIN_SW_RESET + | FB_C09_DOMAIN_SW_RESET | FB_C02_DOMAIN_SW_RESET; + + CRU->C02_CLK_GATE = C02_CLK_GATE_PATH_0_ON | C02_CLK_GATE_PATH_1_ON + | C02_CLK_GATE_PATH_2_ON; + + CRU->C08_X1_CLK_GATE = C08_X1_CLK_GATE_PATH_1_ON + | C08_X1_CLK_GATE_PATH_2_ON; + + CRU->C16_CLK_GATE = C16_CLK_GATE_PATH_0_ON; + + CRU->C21_CLK_GATE = C21_CLK_GATE_PATH_0_ON; + + CRU->C09_CLK_GATE = C09_CLK_GATE_PATH_1_ON | C09_CLK_GATE_PATH_2_ON; +} + + static void eos_s3_cru_init(void) { /* Set desired frequency */ @@ -109,28 +150,17 @@ static void eos_s3_cru_init(void) /* Set divider for domain C11 to ~ 5.12MHz */ CRU->CLK_CTRL_D_0 = (CLK_CTRL_CLK_DIVIDER_ENABLE | CLK_CTRL_CLK_DIVIDER_RATIO_12); + + /* Set C02 clock to default value, + * if any prev app such as boot loader changes it will be set back + */ + CRU->CLK_CTRL_B_0 = 0x204; } #ifdef CONFIG_SOC_EOS_S3_FPGA static void eos_s3_fpga_init(void) { - PMU->FFE_FB_PF_SW_WU = PMU_FFE_FB_PF_SW_WU_PF_WU - | PMU_FFE_FB_PF_SW_WU_FB_WU - | PMU_FFE_FB_PF_SW_WU_FFE_WU; - CRU->FB_SW_RESET = FB_C21_DOMAIN_SW_RESET | FB_C16_DOMAIN_SW_RESET - | FB_C09_DOMAIN_SW_RESET | FB_C02_DOMAIN_SW_RESET; - - CRU->C02_CLK_GATE = C02_CLK_GATE_PATH_0_ON | C02_CLK_GATE_PATH_1_ON - | C02_CLK_GATE_PATH_2_ON; - - CRU->C08_X1_CLK_GATE = C08_X1_CLK_GATE_PATH_1_ON - | C08_X1_CLK_GATE_PATH_2_ON; - - CRU->C16_CLK_GATE = C16_CLK_GATE_PATH_0_ON; - - CRU->C21_CLK_GATE = C21_CLK_GATE_PATH_0_ON; - - CRU->C09_CLK_GATE = C09_CLK_GATE_PATH_0_ON; + enable_fpga_clocks(); PMU->GEN_PURPOSE_0 = 0; PMU->FB_ISOLATION = 0; @@ -143,6 +173,7 @@ static void eos_s3_fpga_init(void) CRU->C08_X4_CLK_GATE = C08_X4_CLK_GATE_PATH_0_ON; + /* Setup Wishbone clock of FPGA to be divided by 8. * Maximum Wishbone clock frequency supported by FPGA is 10MHz. */ @@ -169,6 +200,10 @@ static int eos_s3_init(struct device *arg) eos_s3_cru_init(); eos_s3_lock_disable(); +#ifdef CONFIG_EOS_S3_PROGRAM_FPGA + program_fpga_ip(); +#endif + #ifdef CONFIG_SOC_EOS_S3_FPGA eos_s3_fpga_init(); #endif diff --git a/soc/arm/quicklogic_eos_s3/soc.h b/soc/arm/quicklogic_eos_s3/soc.h index fb8bb9cb70d9fe..68138ad56199a3 100644 --- a/soc/arm/quicklogic_eos_s3/soc.h +++ b/soc/arm/quicklogic_eos_s3/soc.h @@ -53,6 +53,7 @@ void eos_s3_lock_enable(void); void eos_s3_lock_disable(void); int eos_s3_io_mux(u32_t pad_nr, u32_t pad_cfg); +int eos_s3_fbio_select(u32_t pad_nr, u32_t ucFunc); #undef NVIC_DisableIRQ #undef NVIC_EnableIRQ @@ -65,6 +66,9 @@ void EOSS3_DisableIRQ(IRQn_Type IRQn); void EOSS3_EnableIRQ(IRQn_Type IRQn); void EOSS3_ClearPendingIRQ(IRQn_Type IRQn); +void program_fpga_ip(void); +void enable_fpga_clocks(void); + #define NVIC_DisableIRQ EOSS3_DisableIRQ #define NVIC_EnableIRQ EOSS3_EnableIRQ #define NVIC_ClearPendingIRQ EOSS3_ClearPendingIRQ diff --git a/west.yml b/west.yml index cd53369e31648f..2c3b3fb8ba7487 100644 --- a/west.yml +++ b/west.yml @@ -21,8 +21,8 @@ manifest: remotes: - name: upstream url-base: https://github.com/zephyrproject-rtos - - name: antmicro - url-base: https://github.com/antmicro + - name: QuickLogic-Corp + url-base: https://github.com/QuickLogic-Corp # # Please add items below based on alphabetical order @@ -70,7 +70,7 @@ manifest: revision: 45e630d6152824f807d3f919958605c4626cbdff path: modules/hal/libmetal - name: hal_quicklogic - remote: antmicro + remote: QuickLogic-Corp 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